An approach to the formal verification of VHDL descriptions

Bibliographische Detailangaben

1. Verfasser:	Borrione, D. (VerfasserIn)
Weitere Verfasser:	Paillet, Jean-Luc (VerfasserIn)
Format:	UnknownFormat
Sprache:	eng
Veröffentlicht:	Grenoble 1987
Schriftenreihe:	Rapport de recherche / Institut IMAG, Informatique et Mathématiques Appliquées de Grenoble 683
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